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请教一个XILINX V5中的问题

大家好，咨询个问题，以下的程序和约束文件产生的两路输出信号相位一样，为什么呢？
module test1(
input  testclkin,
output testoutput,
output testout2
);
assign testoutput = testclkin;
assign testout2   = testclkin;
endmodule
NET  "testclkin"             IOSTANDARD = LVCMOS33 |LOC = "AC13";
NET  "testoutput"            IOSTANDARD = LVCMOS33 |LOC = "F14";
NET  "testoutput"            OFFSET = OUT  12 ns AFTER "testclkin";
NET  "testout2"              IOSTANDARD = LVCMOS33 |LOC = "D14";
NET  "testout2"              OFFSET = OUT  9 ns AFTER "testclkin";

对INLINX研究少，不太清楚

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笑话,相机与画画

湖边，一个画家正在画画，身后来了一男一女两口子。他们看了一会儿，最后丈夫

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